半導(dǎo)體測(cè)量?jī)x的數(shù)據(jù)傳輸功能研究

　　本文基于一類(lèi)半導(dǎo)體測(cè)量?jī)x器為背景進(jìn)行開(kāi)發(fā)，研究了PCI 總線數(shù)據(jù)傳輸系統(tǒng)，在測(cè)量電路和主機(jī)間完成了雙向數(shù)據(jù)的傳輸。通過(guò)分析 PCI9054 接口類(lèi)型的控制器，實(shí)現(xiàn)了在現(xiàn)場(chǎng)可編程門(mén)陣列單元器件的內(nèi)部，測(cè)試并且完成了本地設(shè)備的總線接口類(lèi)型的電路，譯碼器裝置、FIFO 存儲(chǔ)器等電路單元的開(kāi)發(fā)。隨后實(shí)際運(yùn)行了基于 VisualC++ 語(yǔ)言編寫(xiě)的具有測(cè)試功能的程序軟件，驗(yàn)證了此數(shù)據(jù)傳輸系統(tǒng)可正確、高效地實(shí)現(xiàn)數(shù)據(jù)傳輸?shù)墓δ堋?/p>

　　1. 研究背景

　　通常來(lái)講，半導(dǎo)體測(cè)量裝置一般用于進(jìn)行半導(dǎo)體元件的直流參數(shù)的測(cè)量、材料特性的檢查、生產(chǎn)過(guò)程中的測(cè)試環(huán)節(jié)、過(guò)程監(jiān)控以及最終產(chǎn)品的質(zhì)量控制、產(chǎn)品數(shù)據(jù)報(bào)告的建立、元器件的匹配、產(chǎn)品的失效原因分析、產(chǎn)品的工程測(cè)試等應(yīng)用領(lǐng)域，已經(jīng)在電子產(chǎn)品的開(kāi)發(fā)、研究、制造、測(cè)試環(huán)節(jié)、維修環(huán)節(jié)等層面獲得了非常普遍的實(shí)際應(yīng)用。若要達(dá)成相關(guān)儀器的各類(lèi)測(cè)試方面的功能，首先需要針對(duì)測(cè)量的過(guò)程以及相關(guān)數(shù)據(jù)的捕捉過(guò)程實(shí)施有規(guī)律并且實(shí)時(shí)的監(jiān)控，其次需要保證相關(guān)儀器測(cè)量電路所捕捉到的相關(guān)測(cè)試數(shù)據(jù)通過(guò) AD(模擬，數(shù)字)轉(zhuǎn)換之后，必須做到第一時(shí)間傳輸?shù)诫娔X主機(jī)實(shí)施相應(yīng)的分析和處理操作。上述提到的所有相應(yīng)的控制以及數(shù)據(jù)采集的功能能夠借助一塊配備有 FPGA 芯片單元的PCI 數(shù)據(jù)信息采集卡裝置來(lái)完成。

　　2.PCI 總線的概念簡(jiǎn)介

　　PCI 總線的全稱(chēng)是外圍部件互連總線，也可以簡(jiǎn)稱(chēng)局部的總線。PCI 總線是現(xiàn)階段主板部件上最為普遍的總線形式，其定義了 32 位信息數(shù)據(jù)的總線，并且支持?jǐn)U展到 64 位的規(guī)格(V2.1 版本之上的 PCI 總線的主流執(zhí)行標(biāo)準(zhǔn))。PCI 總線系統(tǒng)適合用于多種類(lèi)的計(jì)算機(jī)平臺(tái)和多類(lèi)型體系架構(gòu)的處理器操作系統(tǒng)，并且可以支持 3.3 伏特以及 5V 伏特 2 種電壓的信號(hào)環(huán)境，能夠通過(guò)升級(jí)轉(zhuǎn)換成為 64 位的總線系統(tǒng)。

　　3.PCI 總線系統(tǒng)的接口類(lèi)型方案的選擇

　　簡(jiǎn)述通常來(lái)講，PCI 總線系統(tǒng)是現(xiàn)階段在各類(lèi)型電腦系統(tǒng)中實(shí)際應(yīng)用最為廣泛的總線系統(tǒng)，比較適用于針對(duì)計(jì)算機(jī)主機(jī)的各類(lèi)功能最大限度的擴(kuò)展工作。

　　一般狀況之下是把所要擴(kuò)展的各項(xiàng)功能采用相應(yīng)的邏輯電路進(jìn)行實(shí)現(xiàn)并且進(jìn)一步制作成擴(kuò)展用的電路板卡的形式，最后經(jīng)過(guò) PCI 總線系統(tǒng)的擴(kuò)展插槽來(lái)實(shí)現(xiàn)其和電腦主機(jī)系統(tǒng)在物理層面上的連接和交互。一般來(lái)實(shí)現(xiàn) PCI 總線系統(tǒng)的接口會(huì)有 2 種方案，也就是說(shuō)可以借助可編程邏輯控制器件來(lái)進(jìn)行，另外就是使用專(zhuān)門(mén)的接口芯片來(lái)實(shí)現(xiàn)。

　　假如借助可編程邏輯控制器件機(jī)型，不僅需要分析相關(guān) PCI 總線系統(tǒng)的信號(hào)以及 PCI 總線系統(tǒng)的相應(yīng)傳輸協(xié)議，還必須掌握到相應(yīng)的 PCI 總線系統(tǒng)具有的特定仲裁機(jī)制、正誤糾正的相關(guān)機(jī)制、奇偶性校驗(yàn)等一整套相應(yīng)的規(guī)則和定義。如果采用專(zhuān)門(mén)的接口芯片來(lái)實(shí)現(xiàn)，則是需要滿(mǎn)足相應(yīng)的 PCI 總線系統(tǒng)的標(biāo)準(zhǔn)規(guī)范的專(zhuān)門(mén)的集成電路，在其接口芯片的內(nèi)部也可能配備了空間以及完成各類(lèi)接口功能的邏輯控制單元。

　　使用專(zhuān)門(mén)的接口芯片這類(lèi)解決方案，具有非常明顯的優(yōu)勢(shì)，也就是說(shuō)，可以避免相關(guān)信息技術(shù)人員為自行規(guī)劃設(shè)計(jì)相應(yīng)的接口電路而在 PCI 總線系統(tǒng)的規(guī)范層面投入不必要的資源以及時(shí)間，進(jìn)而可以耗費(fèi)最短的時(shí)間把研究工作的重點(diǎn)集中到 PCI 總線系統(tǒng)的相關(guān)功能與設(shè)備的開(kāi)發(fā)以及設(shè)計(jì)上面。在本文的開(kāi)發(fā)和設(shè)計(jì)實(shí)踐工作之中，我們選取了第 2 種設(shè)計(jì)方案，也就是說(shuō)采用專(zhuān)門(mén)的接口芯片的解決方案。具體選取的接口芯片是 PLX 公司出品的 PCI9055 型號(hào)的接口芯片，此芯片是由美國(guó) PLX 公司出品。用于針對(duì) PCI 總線系統(tǒng)以及本地的總線(localbus)進(jìn)行橋接操作，從而實(shí)現(xiàn)了電腦主機(jī)和 PCI 總線系統(tǒng)設(shè)備之間的信息交互過(guò)程。

　　4. 本地總線系統(tǒng)的接口邏輯設(shè)計(jì)

　　簡(jiǎn)述為達(dá)成 PCI9055 芯片對(duì)于本地系統(tǒng)中的邏輯資源的存取操作功能，必須要在本地系統(tǒng)端口 FPGA 芯片的內(nèi)部使用 Verilog 類(lèi)型的機(jī)器語(yǔ)言來(lái)設(shè)計(jì)出一套本地系統(tǒng)總線接口的電路。經(jīng)過(guò)分析和研究相關(guān)芯片信息數(shù)據(jù)的手冊(cè)標(biāo)注的時(shí)序邏輯圖，不難看出，此類(lèi)接口位置的電路需要實(shí)現(xiàn) 2 個(gè)基本的邏輯功能，首先是需要根據(jù)準(zhǔn)確的時(shí)序關(guān)系產(chǎn)生出或撤銷(xiāo) LHOLDA#，READY# 類(lèi) 型 的 數(shù) 據(jù) 信 號(hào)， 其 次 是 生 成 對(duì)于本地系統(tǒng)資源可以試試讀、寫(xiě)操作的數(shù)據(jù)信號(hào)。通常，有關(guān) LHOLDA# 類(lèi)型信息信號(hào)的產(chǎn)生與撤銷(xiāo)的問(wèn)題，可能關(guān)系到本地系統(tǒng)總線有關(guān)的仲裁問(wèn)題。

　　如果主機(jī)和 PCI 總線系統(tǒng)相關(guān)的設(shè)備之間需要實(shí)施數(shù)據(jù)信息的傳輸動(dòng) 作 時(shí)，PCI9055 芯 片 的 內(nèi) 部 就 可 以 生 成 LHOLD 類(lèi) 型 的數(shù)據(jù)信號(hào)來(lái)實(shí)現(xiàn)請(qǐng)求使用本地系統(tǒng)總線的目的，這時(shí)采用Verilog 語(yǔ)言中內(nèi)的 always 相關(guān)語(yǔ)句就能夠?qū)崿F(xiàn)在下次的時(shí)鐘脈沖的上升沿出現(xiàn)時(shí)輸出對(duì)應(yīng)的應(yīng)答信號(hào)。對(duì)于 READY# 類(lèi)型的信號(hào)及讀、寫(xiě)信號(hào)可采用同步狀態(tài)機(jī)制來(lái)達(dá)成。如果 PCI9055 芯片收到本地系統(tǒng)總線的信號(hào)之后，將控制地址信號(hào) ADS 發(fā)出寬度數(shù)值為 1 個(gè)周期的低電平脈沖信號(hào)，進(jìn)行相應(yīng)的數(shù)據(jù)傳輸，狀態(tài)機(jī)單元將會(huì)依據(jù)讀操作或者寫(xiě)操作(根據(jù) LWR 信號(hào)的電平類(lèi)別進(jìn)行判別)分別實(shí)現(xiàn)寫(xiě)操作(也就是狀態(tài) 1)以及讀操作(也就是狀態(tài) 2)。

　　隨后再把這 2 個(gè)狀態(tài)之下輸出的有效 READY# 類(lèi)型信號(hào)加上讀、寫(xiě)信號(hào)傳輸?shù)奖镜叵到y(tǒng)的邏輯電路中。在相應(yīng)的數(shù)據(jù)信號(hào)傳輸?shù)倪M(jìn)程之中，READY# 類(lèi)型的信號(hào)需要保持有效，直到有效的 BLAST# 類(lèi)型信號(hào)出現(xiàn)之時(shí)。除此以外，為正常達(dá)成本地系統(tǒng)的邏輯資源讀、寫(xiě)的目的，還必須為本地系統(tǒng)的相關(guān)資源合理分配相應(yīng)的邏輯地址。

　　5. 重要參數(shù)信息的傳輸試驗(yàn)及相關(guān)試驗(yàn)結(jié)果研究

　　半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在進(jìn)行 PCI-bus 協(xié)議的研究過(guò)程中，PCI 輸入接口與輸出接口內(nèi)置芯片的工作模式及工作順序等相關(guān)工作原理的前提條件下，半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在基于 FPGA 核心芯片的前提條件下設(shè)計(jì)出 CAN-bus 輸入接口與輸出接口邏輯供電電路，完成了FIFO 寄存裝置及存儲(chǔ)裝置等邏輯存儲(chǔ)裝置，并且為此類(lèi)資源存儲(chǔ)裝置匹配相應(yīng)的本地連接移動(dòng)物理地址，基于此徹底完成重要數(shù)據(jù)信息采集裝置數(shù)據(jù)傳輸功能的軟件環(huán)境已基本實(shí)現(xiàn)。

　　半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員使用 VisualC++2018相關(guān)項(xiàng)目開(kāi)發(fā)程序在計(jì)算機(jī)客戶(hù)端進(jìn)行測(cè)試程序的編寫(xiě)工作，進(jìn)行此類(lèi)采集卡硬件部分是否可以完成相關(guān)重要參數(shù)信息的傳輸和傳輸過(guò)程中的合理性。半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在進(jìn)行此類(lèi)軟件的測(cè)試過(guò)程中，在通常狀況下應(yīng)用了Windows Driver 開(kāi)發(fā)程序所自帶的各種類(lèi)型數(shù)據(jù)端口二次曲線函數(shù)。軟件的操作界面詳見(jiàn)相關(guān)技術(shù)規(guī)范及相關(guān)標(biāo)準(zhǔn)內(nèi)容進(jìn)行參照。此類(lèi)軟件在通常狀況下需要進(jìn)行以下四部分測(cè)試內(nèi)容：

　　(1)PCI 相關(guān)裝置的開(kāi)啟及關(guān)閉功能的測(cè)試。半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在實(shí)際進(jìn)行操作系統(tǒng)打開(kāi)動(dòng)作以前，必須挑選科學(xué)合理的數(shù)據(jù)傳輸裝置。(2)相關(guān)數(shù)據(jù)傳輸裝置讀取 PCI9054 輸入接口與輸出接口內(nèi)置芯片內(nèi)部寄存裝置的功能。重要參數(shù)信息采集裝置內(nèi)部并行的 EEPROM 芯片能夠?qū)崿F(xiàn)寄存裝置初始數(shù)值的存儲(chǔ)功能，半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在板卡進(jìn)行供電的過(guò)程中，進(jìn)而實(shí)現(xiàn)寄存裝置的合理匹配。

　　(3)半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員使用科學(xué)合理的重要參數(shù)信息的傳輸模式，和板卡本機(jī)輸入接口與輸出接口的關(guān)鍵核心資源(例如寄存裝置)實(shí)施單向的多元化重要數(shù)據(jù)信息的高速傳輸。(4)和板卡輸入接口與輸出接口重要存儲(chǔ)資源(例如FIF1 存儲(chǔ)裝置)完成單向的海量重要參數(shù)信息的高速傳輸。

　　5.1 重要參數(shù)信息使用相關(guān)設(shè)備開(kāi)閉功能研究半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在開(kāi)啟及關(guān)閉過(guò)程中在通常 狀 況 下 使 用(P9057_Open) 和(P9057_Close) 這 兩類(lèi)二次曲線函數(shù)進(jìn)行實(shí)現(xiàn)，基于二次曲線函數(shù)的最大絕對(duì)值能夠評(píng)估出該裝置是否能夠進(jìn)行開(kāi)啟與關(guān)閉。例如半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在將相關(guān)裝置進(jìn)行開(kāi)啟的過(guò)程中，假如能夠?qū)崿F(xiàn)將相關(guān)裝置進(jìn)行正常開(kāi)啟并退回至“TRUE”狀態(tài)，與此相關(guān)將退回至“FALSE”狀態(tài)。半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員進(jìn)行相關(guān)軟件測(cè)試的過(guò)程中，在單擊“裝置開(kāi)啟”的按鈕以后，操作系統(tǒng)的實(shí)施對(duì)話框就會(huì)實(shí)時(shí)彈出，證明該裝置處于正常打開(kāi)的工作狀態(tài)。

　　5.2 PCI9054 寄存相關(guān)裝置的重要參數(shù)信息的讀取試驗(yàn)此類(lèi)功能測(cè)試半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在一般情況下都是借助使用二次曲線函數(shù)進(jìn)行實(shí)現(xiàn)的。在完成相關(guān)代碼編寫(xiě)的過(guò)程中，半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員寫(xiě)出合理的移動(dòng)物理地址就能夠讀取寄存裝置的參數(shù)數(shù)值。半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在相關(guān)重要參數(shù)信息讀取的過(guò)程中，讀取了幾類(lèi)非常關(guān)鍵的寄存裝置的參數(shù)，并且將具體數(shù)值顯示在操作軟件的界面，結(jié)果詳見(jiàn)相關(guān)試驗(yàn)數(shù)據(jù)。與相關(guān)技術(shù)標(biāo)準(zhǔn)工作程序進(jìn)行全方位的對(duì)比，證明測(cè)試軟件可以完成內(nèi)置寄存裝置的讀取。

　　5.3 單次重要參數(shù)信息寫(xiě)入相關(guān)試驗(yàn)半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在使用二次曲線函數(shù)進(jìn)行實(shí)際一次參數(shù)信息讀取操作完成的過(guò)程中，必須在系統(tǒng)軟件內(nèi)部輸入合理的移動(dòng)物理地址、重要參數(shù)信息的字節(jié)寬度、實(shí)際參數(shù)。半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員為了確認(rèn)所讀取重要參數(shù)信息是否正確，將移動(dòng)物理地址寄存裝置進(jìn)行高速寫(xiě)入，得出發(fā)光二極管的工作狀態(tài)，半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員就能夠評(píng)估讀取參數(shù)信息是否正確。

　　5.4 批量重要參數(shù)信息寫(xiě)入相關(guān)試驗(yàn)半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員前期在 FPGA 內(nèi)置芯片的存儲(chǔ)器裝置嵌入一個(gè)周期完整正弦波二次曲線函數(shù)的極坐標(biāo)重要參數(shù)信息，每一個(gè)頻率的二次曲線一共具有 128 個(gè)關(guān)鍵節(jié)點(diǎn)，每一個(gè)極坐標(biāo)參數(shù)包括橫坐標(biāo)與縱坐標(biāo)兩類(lèi)數(shù)值架構(gòu)。

　　半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員使用二次曲線函數(shù)基于高速數(shù)據(jù)信息傳輸模式持續(xù)進(jìn)行極坐標(biāo)重要參數(shù)信息的讀取工作，并且將該重要參數(shù)信息儲(chǔ)存在主機(jī)某個(gè)關(guān)鍵特定的位置，隨后半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員應(yīng)用此類(lèi)極坐標(biāo)重要參數(shù)信息借助 VC 給出的二次曲線函數(shù)在新窗口中完成正弦波二次曲線的求解。在此次軟件測(cè)試過(guò)程中半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員在常規(guī)編程的過(guò)程中一共計(jì)算得出了四個(gè)周期的正弦波二次函數(shù)曲線。

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　　6. 結(jié)語(yǔ)

　　綜上所述，半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員經(jīng)過(guò)針對(duì)相關(guān)應(yīng)用軟件的測(cè)試過(guò)程進(jìn)行非常詳細(xì)的研究得出，本文研究了從最初規(guī)劃設(shè)計(jì)一直到由硬件及軟件兩個(gè)關(guān)鍵層面搭建了一整套行之有效的參數(shù)信息傳輸?shù)倪\(yùn)行體系。半導(dǎo)體測(cè)量相關(guān)工程技術(shù)人員根據(jù)相關(guān)試驗(yàn)結(jié)果說(shuō)明，此類(lèi)半導(dǎo)體測(cè)量裝置可以行之有效以及科學(xué)合理地完成針對(duì)相關(guān)重要參數(shù)信息的傳輸作用，基本最大限度地實(shí)現(xiàn)了初期的規(guī)劃設(shè)計(jì)任務(wù)目標(biāo)。

　　作者：商博雯

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